Architetture riconfigurabili ad Array di processori per l'elaborazione in tempo reale di segnali e immagini tesi di dottorato di ricerca in ingegneria elettronica dell'informazione e dei sistemi
1990
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https://hdl.handle.net/20.500.14242/276046
Il codice NBN di questa tesi è
URN:NBN:IT:POLIMI-276046