UNITesi

VLSI architectures design for encoders of High Efficiency Video Coding (HEVC) standard

XIAO, GUOPING
2016
605.
2016
Inglese
video coding, VLSI design, H.265, HEVC, sum of absolute difference (SAD), TZ search, Maximum value generator, MIMO decoder, nonbinary low-density parity check (LDPC) decoder, selection network (SN), sorting, turbo-product-code decoder.
Politecnico di Torino
100
Politecnico di Torino
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Utilizza questo identificativo per citare o creare un link a questo documento: https://hdl.handle.net/20.500.14242/166576
Il codice NBN di questa tesi è URN:NBN:IT:POLITO-166576